NanjingForestryUniversity/valveboard
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Classic Timing Analyzer report for PF1
Tue Jan 03 15:28:03 2012
Quartus II Version 9.0 Build 132 02/25/2009 SJ Full Version
---------------------
; Table of Contents ;
---------------------
1. Legal Notice
2. Timing Analyzer Summary
3. Timing Analyzer Settings
4. Clock Settings Summary
5. Parallel Compilation
6. Clock Setup: 'clk'
7. Clock Setup: 'SCLK'
8. tsu
9. tco
10. th
11. Timing Analyzer Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2009 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
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programming logic devices manufactured by Altera and sold by
Altera or its authorized distributors. Please refer to the
applicable agreement for further details.
+---------------------------------------------------------------------------------------------------------------------------------------------------------+
; Timing Analyzer Summary ;
+------------------------------+-------+---------------+----------------------------------+-----------+------------+------------+----------+--------------+
; Type ; Slack ; Required Time ; Actual Time ; From ; To ; From Clock ; To Clock ; Failed Paths ;
+------------------------------+-------+---------------+----------------------------------+-----------+------------+------------+----------+--------------+
; Worst-case tsu ; N/A ; None ; 3.893 ns ; SEN ; S_PFr[44] ; -- ; SCLK ; 0 ;
; Worst-case tco ; N/A ; None ; 8.833 ns ; S_PFr2[5] ; S_PF[5] ; clk ; -- ; 0 ;
; Worst-case th ; N/A ; None ; 0.072 ns ; SEN ; i[4] ; -- ; SCLK ; 0 ;
; Clock Setup: 'clk' ; N/A ; None ; 95.93 MHz ( period = 10.424 ns ) ; cnt[17] ; S_PFr2[41] ; clk ; clk ; 0 ;
; Clock Setup: 'SCLK' ; N/A ; None ; 126.07 MHz ( period = 7.932 ns ) ; i[4] ; S_PFr[44] ; SCLK ; SCLK ; 0 ;
; Total number of failed paths ; ; ; ; ; ; ; ; 0 ;
+------------------------------+-------+---------------+----------------------------------+-----------+------------+------------+----------+--------------+
+--------------------------------------------------------------------------------------------------------------------+
; Timing Analyzer Settings ;
+---------------------------------------------------------------------+--------------------+------+----+-------------+
; Option ; Setting ; From ; To ; Entity Name ;
+---------------------------------------------------------------------+--------------------+------+----+-------------+
; Device Name ; EPM240T100C5 ; ; ; ;
; Timing Models ; Final ; ; ; ;
; Default hold multicycle ; Same as Multicycle ; ; ; ;
; Cut paths between unrelated clock domains ; On ; ; ; ;
; Cut off read during write signal paths ; On ; ; ; ;
; Cut off feedback from I/O pins ; On ; ; ; ;
; Report Combined Fast/Slow Timing ; Off ; ; ; ;
; Ignore Clock Settings ; Off ; ; ; ;
; Analyze latches as synchronous elements ; On ; ; ; ;
; Enable Recovery/Removal analysis ; Off ; ; ; ;
; Enable Clock Latency ; Off ; ; ; ;
; Use TimeQuest Timing Analyzer ; Off ; ; ; ;
; Minimum Core Junction Temperature ; 0 ; ; ; ;
; Maximum Core Junction Temperature ; 85 ; ; ; ;
; Number of source nodes to report per destination node ; 10 ; ; ; ;
; Number of destination nodes to report ; 10 ; ; ; ;
; Number of paths to report ; 200 ; ; ; ;
; Report Minimum Timing Checks ; Off ; ; ; ;
; Use Fast Timing Models ; Off ; ; ; ;
; Report IO Paths Separately ; Off ; ; ; ;
; Perform Multicorner Analysis ; Off ; ; ; ;
; Reports the worst-case path for each clock domain and analysis ; Off ; ; ; ;
; Removes common clock path pessimism (CCPP) during slack computation ; Off ; ; ; ;
; Output I/O Timing Endpoint ; Near End ; ; ; ;
+---------------------------------------------------------------------+--------------------+------+----+-------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; clk ; ; User Pin ; None ; 0.000 ns ; 0.000 ns ; -- ; N/A ; N/A ; N/A ; ;
; SCLK ; ; User Pin ; None ; 0.000 ns ; 0.000 ns ; -- ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+------------------------------------------+
; Parallel Compilation ;
+----------------------------+-------------+
; Processors ; Number ;
+----------------------------+-------------+
; Number detected on machine ; 2 ;
; Maximum allowed ; 2 ;
; ; ;
; Average used ; 1.00 ;
; Maximum used ; 1 ;
; ; ;
; Usage by Processor ; % Time Used ;
; 1 processor ; 100.0% ;
; 2 processors ; 0.0% ;
+----------------------------+-------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clk' ;
+-----------------------------------------+-----------------------------------------------------+---------+------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+---------+------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 95.93 MHz ( period = 10.424 ns ) ; cnt[17] ; S_PFr2[41] ; clk ; clk ; None ; None ; 9.715 ns ;
; N/A ; 100.41 MHz ( period = 9.959 ns ) ; cnt[17] ; timer[2] ; clk ; clk ; None ; None ; 9.250 ns ;
; N/A ; 100.41 MHz ( period = 9.959 ns ) ; cnt[17] ; timer[5] ; clk ; clk ; None ; None ; 9.250 ns ;
; N/A ; 100.41 MHz ( period = 9.959 ns ) ; cnt[17] ; timer[3] ; clk ; clk ; None ; None ; 9.250 ns ;
; N/A ; 100.41 MHz ( period = 9.959 ns ) ; cnt[17] ; timer[4] ; clk ; clk ; None ; None ; 9.250 ns ;
; N/A ; 100.41 MHz ( period = 9.959 ns ) ; cnt[17] ; timer[1] ; clk ; clk ; None ; None ; 9.250 ns ;
; N/A ; 100.67 MHz ( period = 9.933 ns ) ; cnt[11] ; S_PFr2[41] ; clk ; clk ; None ; None ; 9.224 ns ;
; N/A ; 101.11 MHz ( period = 9.890 ns ) ; cnt[3] ; S_PFr2[41] ; clk ; clk ; None ; None ; 9.181 ns ;
; N/A ; 101.15 MHz ( period = 9.886 ns ) ; cnt[17] ; S_PFr2[13] ; clk ; clk ; None ; None ; 9.177 ns ;
; N/A ; 101.16 MHz ( period = 9.885 ns ) ; cnt[17] ; S_PFr2[36] ; clk ; clk ; None ; None ; 9.176 ns ;
; N/A ; 101.19 MHz ( period = 9.882 ns ) ; cnt[17] ; S_PFr2[44] ; clk ; clk ; None ; None ; 9.173 ns ;
; N/A ; 101.26 MHz ( period = 9.876 ns ) ; cnt[17] ; S_PFr2[37] ; clk ; clk ; None ; None ; 9.167 ns ;
; N/A ; 101.90 MHz ( period = 9.814 ns ) ; cnt[17] ; cnt[3] ; clk ; clk ; None ; None ; 9.105 ns ;
; N/A ; 101.92 MHz ( period = 9.812 ns ) ; cnt[2] ; S_PFr2[41] ; clk ; clk ; None ; None ; 9.103 ns ;
; N/A ; 102.26 MHz ( period = 9.779 ns ) ; cnt[7] ; S_PFr2[41] ; clk ; clk ; None ; None ; 9.070 ns ;
; N/A ; 102.43 MHz ( period = 9.763 ns ) ; cnt[17] ; cnt[14] ; clk ; clk ; None ; None ; 9.054 ns ;
; N/A ; 102.43 MHz ( period = 9.763 ns ) ; cnt[17] ; cnt[2] ; clk ; clk ; None ; None ; 9.054 ns ;
; N/A ; 103.52 MHz ( period = 9.660 ns ) ; cnt[6] ; S_PFr2[41] ; clk ; clk ; None ; None ; 8.951 ns ;
; N/A ; 103.70 MHz ( period = 9.643 ns ) ; cnt[17] ; S_PFr2[6] ; clk ; clk ; None ; None ; 8.934 ns ;
; N/A ; 103.71 MHz ( period = 9.642 ns ) ; cnt[17] ; S_PFr2[11] ; clk ; clk ; None ; None ; 8.933 ns ;
; N/A ; 103.78 MHz ( period = 9.636 ns ) ; cnt[17] ; S_PFr2[45] ; clk ; clk ; None ; None ; 8.927 ns ;
; N/A ; 103.79 MHz ( period = 9.635 ns ) ; cnt[17] ; S_PFr2[35] ; clk ; clk ; None ; None ; 8.926 ns ;
; N/A ; 103.95 MHz ( period = 9.620 ns ) ; cnt[1] ; S_PFr2[41] ; clk ; clk ; None ; None ; 8.911 ns ;
; N/A ; 104.07 MHz ( period = 9.609 ns ) ; cnt[17] ; S_PFr2[7] ; clk ; clk ; None ; None ; 8.900 ns ;
; N/A ; 104.08 MHz ( period = 9.608 ns ) ; cnt[17] ; S_PFr2[1] ; clk ; clk ; None ; None ; 8.899 ns ;
; N/A ; 104.09 MHz ( period = 9.607 ns ) ; cnt[17] ; S_PFr2[5] ; clk ; clk ; None ; None ; 8.898 ns ;
; N/A ; 104.16 MHz ( period = 9.601 ns ) ; cnt[17] ; cnt[12] ; clk ; clk ; None ; None ; 8.892 ns ;
; N/A ; 104.18 MHz ( period = 9.599 ns ) ; cnt[17] ; cnt[7] ; clk ; clk ; None ; None ; 8.890 ns ;
; N/A ; 104.78 MHz ( period = 9.544 ns ) ; cnt[17] ; cnt[13] ; clk ; clk ; None ; None ; 8.835 ns ;
; N/A ; 105.03 MHz ( period = 9.521 ns ) ; cnt[16] ; S_PFr2[41] ; clk ; clk ; None ; None ; 8.812 ns ;
; N/A ; 105.45 MHz ( period = 9.483 ns ) ; cnt[5] ; S_PFr2[41] ; clk ; clk ; None ; None ; 8.774 ns ;
; N/A ; 105.50 MHz ( period = 9.479 ns ) ; cnt[17] ; S_PFr2[46] ; clk ; clk ; None ; None ; 8.770 ns ;
; N/A ; 105.53 MHz ( period = 9.476 ns ) ; cnt[17] ; S_PFr2[10] ; clk ; clk ; None ; None ; 8.767 ns ;
; N/A ; 105.53 MHz ( period = 9.476 ns ) ; cnt[0] ; S_PFr2[41] ; clk ; clk ; None ; None ; 8.767 ns ;
; N/A ; 105.59 MHz ( period = 9.471 ns ) ; cnt[17] ; S_PFr2[12] ; clk ; clk ; None ; None ; 8.762 ns ;
; N/A ; 105.59 MHz ( period = 9.471 ns ) ; cnt[17] ; S_PFr2[15] ; clk ; clk ; None ; None ; 8.762 ns ;
; N/A ; 105.62 MHz ( period = 9.468 ns ) ; cnt[11] ; timer[2] ; clk ; clk ; None ; None ; 8.759 ns ;
; N/A ; 105.62 MHz ( period = 9.468 ns ) ; cnt[11] ; timer[5] ; clk ; clk ; None ; None ; 8.759 ns ;
; N/A ; 105.62 MHz ( period = 9.468 ns ) ; cnt[11] ; timer[3] ; clk ; clk ; None ; None ; 8.759 ns ;
; N/A ; 105.62 MHz ( period = 9.468 ns ) ; cnt[11] ; timer[4] ; clk ; clk ; None ; None ; 8.759 ns ;
; N/A ; 105.62 MHz ( period = 9.468 ns ) ; cnt[11] ; timer[1] ; clk ; clk ; None ; None ; 8.759 ns ;
; N/A ; 105.86 MHz ( period = 9.446 ns ) ; cnt[4] ; S_PFr2[41] ; clk ; clk ; None ; None ; 8.737 ns ;
; N/A ; 106.02 MHz ( period = 9.432 ns ) ; cnt[17] ; cnt[11] ; clk ; clk ; None ; None ; 8.723 ns ;
; N/A ; 106.03 MHz ( period = 9.431 ns ) ; cnt[17] ; cnt[15] ; clk ; clk ; None ; None ; 8.722 ns ;
; N/A ; 106.10 MHz ( period = 9.425 ns ) ; cnt[3] ; timer[2] ; clk ; clk ; None ; None ; 8.716 ns ;
; N/A ; 106.10 MHz ( period = 9.425 ns ) ; cnt[3] ; timer[5] ; clk ; clk ; None ; None ; 8.716 ns ;
; N/A ; 106.10 MHz ( period = 9.425 ns ) ; cnt[3] ; timer[3] ; clk ; clk ; None ; None ; 8.716 ns ;
; N/A ; 106.10 MHz ( period = 9.425 ns ) ; cnt[3] ; timer[4] ; clk ; clk ; None ; None ; 8.716 ns ;
; N/A ; 106.10 MHz ( period = 9.425 ns ) ; cnt[3] ; timer[1] ; clk ; clk ; None ; None ; 8.716 ns ;
; N/A ; 106.15 MHz ( period = 9.421 ns ) ; cnt[17] ; S_PFr2[27] ; clk ; clk ; None ; None ; 8.712 ns ;
; N/A ; 106.16 MHz ( period = 9.420 ns ) ; cnt[17] ; cnt[6] ; clk ; clk ; None ; None ; 8.711 ns ;
; N/A ; 106.44 MHz ( period = 9.395 ns ) ; cnt[11] ; S_PFr2[13] ; clk ; clk ; None ; None ; 8.686 ns ;
; N/A ; 106.45 MHz ( period = 9.394 ns ) ; cnt[11] ; S_PFr2[36] ; clk ; clk ; None ; None ; 8.685 ns ;
; N/A ; 106.48 MHz ( period = 9.391 ns ) ; cnt[11] ; S_PFr2[44] ; clk ; clk ; None ; None ; 8.682 ns ;
; N/A ; 106.55 MHz ( period = 9.385 ns ) ; cnt[11] ; S_PFr2[37] ; clk ; clk ; None ; None ; 8.676 ns ;
; N/A ; 106.68 MHz ( period = 9.374 ns ) ; cnt[17] ; S_PFr2[28] ; clk ; clk ; None ; None ; 8.665 ns ;
; N/A ; 106.69 MHz ( period = 9.373 ns ) ; cnt[17] ; cnt[1] ; clk ; clk ; None ; None ; 8.664 ns ;
; N/A ; 106.76 MHz ( period = 9.367 ns ) ; cnt[17] ; S_PFr2[25] ; clk ; clk ; None ; None ; 8.658 ns ;
; N/A ; 106.78 MHz ( period = 9.365 ns ) ; cnt[17] ; S_PFr2[21] ; clk ; clk ; None ; None ; 8.656 ns ;
; N/A ; 106.79 MHz ( period = 9.364 ns ) ; cnt[17] ; S_PFr2[3] ; clk ; clk ; None ; None ; 8.655 ns ;
; N/A ; 106.88 MHz ( period = 9.356 ns ) ; cnt[17] ; S_PFr2[18] ; clk ; clk ; None ; None ; 8.647 ns ;
; N/A ; 106.93 MHz ( period = 9.352 ns ) ; cnt[3] ; S_PFr2[13] ; clk ; clk ; None ; None ; 8.643 ns ;
; N/A ; 106.94 MHz ( period = 9.351 ns ) ; cnt[3] ; S_PFr2[36] ; clk ; clk ; None ; None ; 8.642 ns ;
; N/A ; 106.97 MHz ( period = 9.348 ns ) ; cnt[3] ; S_PFr2[44] ; clk ; clk ; None ; None ; 8.639 ns ;
; N/A ; 106.99 MHz ( period = 9.347 ns ) ; cnt[2] ; timer[2] ; clk ; clk ; None ; None ; 8.638 ns ;
; N/A ; 106.99 MHz ( period = 9.347 ns ) ; cnt[2] ; timer[5] ; clk ; clk ; None ; None ; 8.638 ns ;
; N/A ; 106.99 MHz ( period = 9.347 ns ) ; cnt[2] ; timer[3] ; clk ; clk ; None ; None ; 8.638 ns ;
; N/A ; 106.99 MHz ( period = 9.347 ns ) ; cnt[2] ; timer[4] ; clk ; clk ; None ; None ; 8.638 ns ;
; N/A ; 106.99 MHz ( period = 9.347 ns ) ; cnt[2] ; timer[1] ; clk ; clk ; None ; None ; 8.638 ns ;
; N/A ; 107.01 MHz ( period = 9.345 ns ) ; cnt[17] ; cnt[4] ; clk ; clk ; None ; None ; 8.636 ns ;
; N/A ; 107.01 MHz ( period = 9.345 ns ) ; cnt[17] ; cnt[0] ; clk ; clk ; None ; None ; 8.636 ns ;
; N/A ; 107.04 MHz ( period = 9.342 ns ) ; cnt[3] ; S_PFr2[37] ; clk ; clk ; None ; None ; 8.633 ns ;
; N/A ; 107.04 MHz ( period = 9.342 ns ) ; cnt[17] ; cnt[5] ; clk ; clk ; None ; None ; 8.633 ns ;
; N/A ; 107.07 MHz ( period = 9.340 ns ) ; cnt[17] ; S_PFr2[26] ; clk ; clk ; None ; None ; 8.631 ns ;
; N/A ; 107.26 MHz ( period = 9.323 ns ) ; cnt[11] ; cnt[3] ; clk ; clk ; None ; None ; 8.614 ns ;
; N/A ; 107.30 MHz ( period = 9.320 ns ) ; cnt[17] ; S_PFr2[43] ; clk ; clk ; None ; None ; 8.611 ns ;
; N/A ; 107.37 MHz ( period = 9.314 ns ) ; cnt[7] ; timer[2] ; clk ; clk ; None ; None ; 8.605 ns ;
; N/A ; 107.37 MHz ( period = 9.314 ns ) ; cnt[7] ; timer[5] ; clk ; clk ; None ; None ; 8.605 ns ;
; N/A ; 107.37 MHz ( period = 9.314 ns ) ; cnt[7] ; timer[3] ; clk ; clk ; None ; None ; 8.605 ns ;
; N/A ; 107.37 MHz ( period = 9.314 ns ) ; cnt[7] ; timer[4] ; clk ; clk ; None ; None ; 8.605 ns ;
; N/A ; 107.37 MHz ( period = 9.314 ns ) ; cnt[7] ; timer[1] ; clk ; clk ; None ; None ; 8.605 ns ;
; N/A ; 107.76 MHz ( period = 9.280 ns ) ; cnt[3] ; cnt[3] ; clk ; clk ; None ; None ; 8.571 ns ;
; N/A ; 107.83 MHz ( period = 9.274 ns ) ; cnt[2] ; S_PFr2[13] ; clk ; clk ; None ; None ; 8.565 ns ;
; N/A ; 107.84 MHz ( period = 9.273 ns ) ; cnt[2] ; S_PFr2[36] ; clk ; clk ; None ; None ; 8.564 ns ;
; N/A ; 107.84 MHz ( period = 9.273 ns ) ; cnt[9] ; S_PFr2[41] ; clk ; clk ; None ; None ; 8.564 ns ;
; N/A ; 107.85 MHz ( period = 9.272 ns ) ; cnt[11] ; cnt[14] ; clk ; clk ; None ; None ; 8.563 ns ;
; N/A ; 107.85 MHz ( period = 9.272 ns ) ; cnt[11] ; cnt[2] ; clk ; clk ; None ; None ; 8.563 ns ;
; N/A ; 107.87 MHz ( period = 9.270 ns ) ; cnt[2] ; S_PFr2[44] ; clk ; clk ; None ; None ; 8.561 ns ;
; N/A ; 107.94 MHz ( period = 9.264 ns ) ; cnt[2] ; S_PFr2[37] ; clk ; clk ; None ; None ; 8.555 ns ;
; N/A ; 108.21 MHz ( period = 9.241 ns ) ; cnt[7] ; S_PFr2[13] ; clk ; clk ; None ; None ; 8.532 ns ;
; N/A ; 108.23 MHz ( period = 9.240 ns ) ; cnt[7] ; S_PFr2[36] ; clk ; clk ; None ; None ; 8.531 ns ;
; N/A ; 108.26 MHz ( period = 9.237 ns ) ; cnt[7] ; S_PFr2[44] ; clk ; clk ; None ; None ; 8.528 ns ;
; N/A ; 108.31 MHz ( period = 9.233 ns ) ; cnt[17] ; S_PFr2[16] ; clk ; clk ; None ; None ; 8.524 ns ;
; N/A ; 108.33 MHz ( period = 9.231 ns ) ; cnt[7] ; S_PFr2[37] ; clk ; clk ; None ; None ; 8.522 ns ;
; N/A ; 108.35 MHz ( period = 9.229 ns ) ; cnt[3] ; cnt[14] ; clk ; clk ; None ; None ; 8.520 ns ;
; N/A ; 108.35 MHz ( period = 9.229 ns ) ; cnt[3] ; cnt[2] ; clk ; clk ; None ; None ; 8.520 ns ;
; N/A ; 108.39 MHz ( period = 9.226 ns ) ; cnt[17] ; S_PFr2[17] ; clk ; clk ; None ; None ; 8.517 ns ;
; N/A ; 108.42 MHz ( period = 9.223 ns ) ; cnt[17] ; cnt[17] ; clk ; clk ; None ; None ; 8.514 ns ;
; N/A ; 108.67 MHz ( period = 9.202 ns ) ; cnt[2] ; cnt[3] ; clk ; clk ; None ; None ; 8.493 ns ;
; N/A ; 108.75 MHz ( period = 9.195 ns ) ; cnt[6] ; timer[2] ; clk ; clk ; None ; None ; 8.486 ns ;
; N/A ; 108.75 MHz ( period = 9.195 ns ) ; cnt[6] ; timer[5] ; clk ; clk ; None ; None ; 8.486 ns ;
; N/A ; 108.75 MHz ( period = 9.195 ns ) ; cnt[6] ; timer[3] ; clk ; clk ; None ; None ; 8.486 ns ;
; N/A ; 108.75 MHz ( period = 9.195 ns ) ; cnt[6] ; timer[4] ; clk ; clk ; None ; None ; 8.486 ns ;
; N/A ; 108.75 MHz ( period = 9.195 ns ) ; cnt[6] ; timer[1] ; clk ; clk ; None ; None ; 8.486 ns ;
; N/A ; 109.06 MHz ( period = 9.169 ns ) ; cnt[7] ; cnt[3] ; clk ; clk ; None ; None ; 8.460 ns ;
; N/A ; 109.23 MHz ( period = 9.155 ns ) ; cnt[1] ; timer[2] ; clk ; clk ; None ; None ; 8.446 ns ;
; N/A ; 109.23 MHz ( period = 9.155 ns ) ; cnt[1] ; timer[5] ; clk ; clk ; None ; None ; 8.446 ns ;
; N/A ; 109.23 MHz ( period = 9.155 ns ) ; cnt[1] ; timer[3] ; clk ; clk ; None ; None ; 8.446 ns ;
; N/A ; 109.23 MHz ( period = 9.155 ns ) ; cnt[1] ; timer[4] ; clk ; clk ; None ; None ; 8.446 ns ;
; N/A ; 109.23 MHz ( period = 9.155 ns ) ; cnt[17] ; cnt[16] ; clk ; clk ; None ; None ; 8.446 ns ;
; N/A ; 109.23 MHz ( period = 9.155 ns ) ; cnt[1] ; timer[1] ; clk ; clk ; None ; None ; 8.446 ns ;
; N/A ; 109.27 MHz ( period = 9.152 ns ) ; cnt[11] ; S_PFr2[6] ; clk ; clk ; None ; None ; 8.443 ns ;
; N/A ; 109.28 MHz ( period = 9.151 ns ) ; cnt[11] ; S_PFr2[11] ; clk ; clk ; None ; None ; 8.442 ns ;
; N/A ; 109.28 MHz ( period = 9.151 ns ) ; cnt[2] ; cnt[14] ; clk ; clk ; None ; None ; 8.442 ns ;
; N/A ; 109.28 MHz ( period = 9.151 ns ) ; cnt[2] ; cnt[2] ; clk ; clk ; None ; None ; 8.442 ns ;
; N/A ; 109.35 MHz ( period = 9.145 ns ) ; cnt[11] ; S_PFr2[45] ; clk ; clk ; None ; None ; 8.436 ns ;
; N/A ; 109.36 MHz ( period = 9.144 ns ) ; cnt[11] ; S_PFr2[35] ; clk ; clk ; None ; None ; 8.435 ns ;
; N/A ; 109.43 MHz ( period = 9.138 ns ) ; cnt[17] ; cnt[19] ; clk ; clk ; None ; None ; 8.429 ns ;
; N/A ; 109.63 MHz ( period = 9.122 ns ) ; cnt[6] ; S_PFr2[13] ; clk ; clk ; None ; None ; 8.413 ns ;
; N/A ; 109.64 MHz ( period = 9.121 ns ) ; cnt[6] ; S_PFr2[36] ; clk ; clk ; None ; None ; 8.412 ns ;
; N/A ; 109.67 MHz ( period = 9.118 ns ) ; cnt[11] ; S_PFr2[7] ; clk ; clk ; None ; None ; 8.409 ns ;
; N/A ; 109.67 MHz ( period = 9.118 ns ) ; cnt[6] ; S_PFr2[44] ; clk ; clk ; None ; None ; 8.409 ns ;
; N/A ; 109.67 MHz ( period = 9.118 ns ) ; cnt[7] ; cnt[14] ; clk ; clk ; None ; None ; 8.409 ns ;
; N/A ; 109.67 MHz ( period = 9.118 ns ) ; cnt[7] ; cnt[2] ; clk ; clk ; None ; None ; 8.409 ns ;
; N/A ; 109.69 MHz ( period = 9.117 ns ) ; cnt[11] ; S_PFr2[1] ; clk ; clk ; None ; None ; 8.408 ns ;
; N/A ; 109.69 MHz ( period = 9.117 ns ) ; cnt[16] ; cnt[16] ; clk ; clk ; None ; None ; 8.408 ns ;
; N/A ; 109.70 MHz ( period = 9.116 ns ) ; cnt[11] ; S_PFr2[5] ; clk ; clk ; None ; None ; 8.407 ns ;
; N/A ; 109.75 MHz ( period = 9.112 ns ) ; cnt[6] ; S_PFr2[37] ; clk ; clk ; None ; None ; 8.403 ns ;
; N/A ; 109.77 MHz ( period = 9.110 ns ) ; cnt[11] ; cnt[12] ; clk ; clk ; None ; None ; 8.401 ns ;
; N/A ; 109.78 MHz ( period = 9.109 ns ) ; cnt[3] ; S_PFr2[6] ; clk ; clk ; None ; None ; 8.400 ns ;
; N/A ; 109.79 MHz ( period = 9.108 ns ) ; cnt[3] ; S_PFr2[11] ; clk ; clk ; None ; None ; 8.399 ns ;
; N/A ; 109.79 MHz ( period = 9.108 ns ) ; cnt[11] ; cnt[7] ; clk ; clk ; None ; None ; 8.399 ns ;
; N/A ; 109.87 MHz ( period = 9.102 ns ) ; cnt[3] ; S_PFr2[45] ; clk ; clk ; None ; None ; 8.393 ns ;
; N/A ; 109.88 MHz ( period = 9.101 ns ) ; cnt[3] ; S_PFr2[35] ; clk ; clk ; None ; None ; 8.392 ns ;
; N/A ; 109.99 MHz ( period = 9.092 ns ) ; cnt[7] ; cnt[19] ; clk ; clk ; None ; None ; 8.383 ns ;
; N/A ; 110.11 MHz ( period = 9.082 ns ) ; cnt[1] ; S_PFr2[13] ; clk ; clk ; None ; None ; 8.373 ns ;
; N/A ; 110.12 MHz ( period = 9.081 ns ) ; cnt[1] ; S_PFr2[36] ; clk ; clk ; None ; None ; 8.372 ns ;
; N/A ; 110.16 MHz ( period = 9.078 ns ) ; cnt[1] ; S_PFr2[44] ; clk ; clk ; None ; None ; 8.369 ns ;
; N/A ; 110.19 MHz ( period = 9.075 ns ) ; cnt[3] ; S_PFr2[7] ; clk ; clk ; None ; None ; 8.366 ns ;
; N/A ; 110.20 MHz ( period = 9.074 ns ) ; cnt[3] ; S_PFr2[1] ; clk ; clk ; None ; None ; 8.365 ns ;
; N/A ; 110.22 MHz ( period = 9.073 ns ) ; cnt[3] ; S_PFr2[5] ; clk ; clk ; None ; None ; 8.364 ns ;
; N/A ; 110.23 MHz ( period = 9.072 ns ) ; cnt[1] ; S_PFr2[37] ; clk ; clk ; None ; None ; 8.363 ns ;
; N/A ; 110.29 MHz ( period = 9.067 ns ) ; cnt[3] ; cnt[12] ; clk ; clk ; None ; None ; 8.358 ns ;
; N/A ; 110.31 MHz ( period = 9.065 ns ) ; cnt[3] ; cnt[7] ; clk ; clk ; None ; None ; 8.356 ns ;
; N/A ; 110.42 MHz ( period = 9.056 ns ) ; cnt[16] ; timer[2] ; clk ; clk ; None ; None ; 8.347 ns ;
; N/A ; 110.42 MHz ( period = 9.056 ns ) ; cnt[16] ; timer[5] ; clk ; clk ; None ; None ; 8.347 ns ;
; N/A ; 110.42 MHz ( period = 9.056 ns ) ; cnt[16] ; timer[3] ; clk ; clk ; None ; None ; 8.347 ns ;
; N/A ; 110.42 MHz ( period = 9.056 ns ) ; cnt[16] ; timer[4] ; clk ; clk ; None ; None ; 8.347 ns ;
; N/A ; 110.42 MHz ( period = 9.056 ns ) ; cnt[16] ; timer[1] ; clk ; clk ; None ; None ; 8.347 ns ;
; N/A ; 110.46 MHz ( period = 9.053 ns ) ; cnt[11] ; cnt[13] ; clk ; clk ; None ; None ; 8.344 ns ;
; N/A ; 110.50 MHz ( period = 9.050 ns ) ; cnt[6] ; cnt[3] ; clk ; clk ; None ; None ; 8.341 ns ;
; N/A ; 110.58 MHz ( period = 9.043 ns ) ; cnt[17] ; timer[0] ; clk ; clk ; None ; None ; 8.334 ns ;
; N/A ; 110.73 MHz ( period = 9.031 ns ) ; cnt[2] ; S_PFr2[6] ; clk ; clk ; None ; None ; 8.322 ns ;
; N/A ; 110.74 MHz ( period = 9.030 ns ) ; cnt[2] ; S_PFr2[11] ; clk ; clk ; None ; None ; 8.321 ns ;
; N/A ; 110.82 MHz ( period = 9.024 ns ) ; cnt[10] ; S_PFr2[41] ; clk ; clk ; None ; None ; 8.315 ns ;
; N/A ; 110.82 MHz ( period = 9.024 ns ) ; cnt[2] ; S_PFr2[45] ; clk ; clk ; None ; None ; 8.315 ns ;
; N/A ; 110.83 MHz ( period = 9.023 ns ) ; cnt[2] ; S_PFr2[35] ; clk ; clk ; None ; None ; 8.314 ns ;
; N/A ; 110.89 MHz ( period = 9.018 ns ) ; cnt[5] ; timer[2] ; clk ; clk ; None ; None ; 8.309 ns ;
; N/A ; 110.89 MHz ( period = 9.018 ns ) ; cnt[5] ; timer[5] ; clk ; clk ; None ; None ; 8.309 ns ;
; N/A ; 110.89 MHz ( period = 9.018 ns ) ; cnt[5] ; timer[3] ; clk ; clk ; None ; None ; 8.309 ns ;
; N/A ; 110.89 MHz ( period = 9.018 ns ) ; cnt[5] ; timer[4] ; clk ; clk ; None ; None ; 8.309 ns ;
; N/A ; 110.89 MHz ( period = 9.018 ns ) ; cnt[5] ; timer[1] ; clk ; clk ; None ; None ; 8.309 ns ;
; N/A ; 110.98 MHz ( period = 9.011 ns ) ; cnt[0] ; timer[2] ; clk ; clk ; None ; None ; 8.302 ns ;
; N/A ; 110.98 MHz ( period = 9.011 ns ) ; cnt[0] ; timer[5] ; clk ; clk ; None ; None ; 8.302 ns ;
; N/A ; 110.98 MHz ( period = 9.011 ns ) ; cnt[0] ; timer[3] ; clk ; clk ; None ; None ; 8.302 ns ;
; N/A ; 110.98 MHz ( period = 9.011 ns ) ; cnt[0] ; timer[4] ; clk ; clk ; None ; None ; 8.302 ns ;
; N/A ; 110.98 MHz ( period = 9.011 ns ) ; cnt[0] ; timer[1] ; clk ; clk ; None ; None ; 8.302 ns ;
; N/A ; 110.99 MHz ( period = 9.010 ns ) ; cnt[3] ; cnt[13] ; clk ; clk ; None ; None ; 8.301 ns ;
; N/A ; 110.99 MHz ( period = 9.010 ns ) ; cnt[1] ; cnt[3] ; clk ; clk ; None ; None ; 8.301 ns ;
; N/A ; 111.12 MHz ( period = 8.999 ns ) ; cnt[6] ; cnt[14] ; clk ; clk ; None ; None ; 8.290 ns ;
; N/A ; 111.12 MHz ( period = 8.999 ns ) ; cnt[6] ; cnt[2] ; clk ; clk ; None ; None ; 8.290 ns ;
; N/A ; 111.14 MHz ( period = 8.998 ns ) ; cnt[7] ; S_PFr2[6] ; clk ; clk ; None ; None ; 8.289 ns ;
; N/A ; 111.15 MHz ( period = 8.997 ns ) ; cnt[2] ; S_PFr2[7] ; clk ; clk ; None ; None ; 8.288 ns ;
; N/A ; 111.15 MHz ( period = 8.997 ns ) ; cnt[7] ; S_PFr2[11] ; clk ; clk ; None ; None ; 8.288 ns ;
; N/A ; 111.16 MHz ( period = 8.996 ns ) ; cnt[2] ; S_PFr2[1] ; clk ; clk ; None ; None ; 8.287 ns ;
; N/A ; 111.17 MHz ( period = 8.995 ns ) ; cnt[2] ; S_PFr2[5] ; clk ; clk ; None ; None ; 8.286 ns ;
; N/A ; 111.22 MHz ( period = 8.991 ns ) ; cnt[7] ; S_PFr2[45] ; clk ; clk ; None ; None ; 8.282 ns ;
; N/A ; 111.23 MHz ( period = 8.990 ns ) ; cnt[7] ; S_PFr2[35] ; clk ; clk ; None ; None ; 8.281 ns ;
; N/A ; 111.25 MHz ( period = 8.989 ns ) ; cnt[2] ; cnt[12] ; clk ; clk ; None ; None ; 8.280 ns ;
; N/A ; 111.26 MHz ( period = 8.988 ns ) ; cnt[11] ; S_PFr2[46] ; clk ; clk ; None ; None ; 8.279 ns ;
; N/A ; 111.27 MHz ( period = 8.987 ns ) ; cnt[2] ; cnt[7] ; clk ; clk ; None ; None ; 8.278 ns ;
; N/A ; 111.30 MHz ( period = 8.985 ns ) ; cnt[11] ; S_PFr2[10] ; clk ; clk ; None ; None ; 8.276 ns ;
; N/A ; 111.32 MHz ( period = 8.983 ns ) ; cnt[16] ; S_PFr2[13] ; clk ; clk ; None ; None ; 8.274 ns ;
; N/A ; 111.33 MHz ( period = 8.982 ns ) ; cnt[16] ; S_PFr2[36] ; clk ; clk ; None ; None ; 8.273 ns ;
; N/A ; 111.35 MHz ( period = 8.981 ns ) ; cnt[4] ; timer[2] ; clk ; clk ; None ; None ; 8.272 ns ;
; N/A ; 111.35 MHz ( period = 8.981 ns ) ; cnt[4] ; timer[5] ; clk ; clk ; None ; None ; 8.272 ns ;
; N/A ; 111.35 MHz ( period = 8.981 ns ) ; cnt[4] ; timer[3] ; clk ; clk ; None ; None ; 8.272 ns ;
; N/A ; 111.35 MHz ( period = 8.981 ns ) ; cnt[4] ; timer[4] ; clk ; clk ; None ; None ; 8.272 ns ;
; N/A ; 111.35 MHz ( period = 8.981 ns ) ; cnt[4] ; timer[1] ; clk ; clk ; None ; None ; 8.272 ns ;
; N/A ; 111.36 MHz ( period = 8.980 ns ) ; cnt[11] ; S_PFr2[12] ; clk ; clk ; None ; None ; 8.271 ns ;
; N/A ; 111.36 MHz ( period = 8.980 ns ) ; cnt[11] ; S_PFr2[15] ; clk ; clk ; None ; None ; 8.271 ns ;
; N/A ; 111.37 MHz ( period = 8.979 ns ) ; cnt[16] ; S_PFr2[44] ; clk ; clk ; None ; None ; 8.270 ns ;
; N/A ; 111.45 MHz ( period = 8.973 ns ) ; cnt[16] ; S_PFr2[37] ; clk ; clk ; None ; None ; 8.264 ns ;
; N/A ; 111.56 MHz ( period = 8.964 ns ) ; cnt[7] ; S_PFr2[7] ; clk ; clk ; None ; None ; 8.255 ns ;
; N/A ; 111.57 MHz ( period = 8.963 ns ) ; cnt[7] ; S_PFr2[1] ; clk ; clk ; None ; None ; 8.254 ns ;
; N/A ; 111.58 MHz ( period = 8.962 ns ) ; cnt[7] ; S_PFr2[5] ; clk ; clk ; None ; None ; 8.253 ns ;
; N/A ; 111.62 MHz ( period = 8.959 ns ) ; cnt[1] ; cnt[14] ; clk ; clk ; None ; None ; 8.250 ns ;
; N/A ; 111.62 MHz ( period = 8.959 ns ) ; cnt[1] ; cnt[2] ; clk ; clk ; None ; None ; 8.250 ns ;
; N/A ; 111.66 MHz ( period = 8.956 ns ) ; cnt[7] ; cnt[12] ; clk ; clk ; None ; None ; 8.247 ns ;
; N/A ; 111.68 MHz ( period = 8.954 ns ) ; cnt[7] ; cnt[7] ; clk ; clk ; None ; None ; 8.245 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+---------+------------+------------+----------+-----------------------------+---------------------------+-------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'SCLK' ;
+-----------------------------------------+-----------------------------------------------------+------+-----------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+------+-----------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 126.07 MHz ( period = 7.932 ns ) ; i[4] ; S_PFr[44] ; SCLK ; SCLK ; None ; None ; 7.223 ns ;
; N/A ; 130.94 MHz ( period = 7.637 ns ) ; i[4] ; S_PFr[14] ; SCLK ; SCLK ; None ; None ; 6.928 ns ;
; N/A ; 131.03 MHz ( period = 7.632 ns ) ; i[4] ; S_PFr[12] ; SCLK ; SCLK ; None ; None ; 6.923 ns ;
; N/A ; 131.06 MHz ( period = 7.630 ns ) ; i[4] ; S_PFr[10] ; SCLK ; SCLK ; None ; None ; 6.921 ns ;
; N/A ; 131.48 MHz ( period = 7.606 ns ) ; i[4] ; S_PFr[47] ; SCLK ; SCLK ; None ; None ; 6.897 ns ;
; N/A ; 131.58 MHz ( period = 7.600 ns ) ; i[4] ; S_PFr[36] ; SCLK ; SCLK ; None ; None ; 6.891 ns ;
; N/A ; 132.17 MHz ( period = 7.566 ns ) ; i[4] ; S_PFr[34] ; SCLK ; SCLK ; None ; None ; 6.857 ns ;
; N/A ; 132.36 MHz ( period = 7.555 ns ) ; i[4] ; S_PFr[32] ; SCLK ; SCLK ; None ; None ; 6.846 ns ;
; N/A ; 134.16 MHz ( period = 7.454 ns ) ; i[4] ; S_PFr[19] ; SCLK ; SCLK ; None ; None ; 6.745 ns ;
; N/A ; 135.41 MHz ( period = 7.385 ns ) ; i[5] ; S_PFr[14] ; SCLK ; SCLK ; None ; None ; 6.676 ns ;
; N/A ; 135.48 MHz ( period = 7.381 ns ) ; i[0] ; S_PFr[44] ; SCLK ; SCLK ; None ; None ; 6.672 ns ;
; N/A ; 135.50 MHz ( period = 7.380 ns ) ; i[5] ; S_PFr[12] ; SCLK ; SCLK ; None ; None ; 6.671 ns ;
; N/A ; 135.54 MHz ( period = 7.378 ns ) ; i[5] ; S_PFr[10] ; SCLK ; SCLK ; None ; None ; 6.669 ns ;
; N/A ; 135.63 MHz ( period = 7.373 ns ) ; i[4] ; S_PFr[43] ; SCLK ; SCLK ; None ; None ; 6.664 ns ;
; N/A ; 136.04 MHz ( period = 7.351 ns ) ; i[0] ; S_PFr[19] ; SCLK ; SCLK ; None ; None ; 6.642 ns ;
; N/A ; 136.05 MHz ( period = 7.350 ns ) ; i[2] ; S_PFr[16] ; SCLK ; SCLK ; None ; None ; 6.641 ns ;
; N/A ; 136.84 MHz ( period = 7.308 ns ) ; i[4] ; S_PFr[5] ; SCLK ; SCLK ; None ; None ; 6.599 ns ;
; N/A ; 137.38 MHz ( period = 7.279 ns ) ; i[0] ; S_PFr[14] ; SCLK ; SCLK ; None ; None ; 6.570 ns ;
; N/A ; 137.48 MHz ( period = 7.274 ns ) ; i[0] ; S_PFr[12] ; SCLK ; SCLK ; None ; None ; 6.565 ns ;
; N/A ; 137.51 MHz ( period = 7.272 ns ) ; i[0] ; S_PFr[10] ; SCLK ; SCLK ; None ; None ; 6.563 ns ;
; N/A ; 137.82 MHz ( period = 7.256 ns ) ; i[4] ; S_PFr[46] ; SCLK ; SCLK ; None ; None ; 6.547 ns ;
; N/A ; 138.06 MHz ( period = 7.243 ns ) ; i[4] ; S_PFr[39] ; SCLK ; SCLK ; None ; None ; 6.534 ns ;
; N/A ; 139.06 MHz ( period = 7.191 ns ) ; i[4] ; S_PFr[18] ; SCLK ; SCLK ; None ; None ; 6.482 ns ;
; N/A ; 139.88 MHz ( period = 7.149 ns ) ; i[4] ; S_PFr[21] ; SCLK ; SCLK ; None ; None ; 6.440 ns ;
; N/A ; 139.88 MHz ( period = 7.149 ns ) ; i[4] ; S_PFr[25] ; SCLK ; SCLK ; None ; None ; 6.440 ns ;
; N/A ; 139.90 MHz ( period = 7.148 ns ) ; i[2] ; S_PFr[22] ; SCLK ; SCLK ; None ; None ; 6.439 ns ;
; N/A ; 139.94 MHz ( period = 7.146 ns ) ; i[5] ; S_PFr[5] ; SCLK ; SCLK ; None ; None ; 6.437 ns ;
; N/A ; 139.98 MHz ( period = 7.144 ns ) ; i[2] ; S_PFr[23] ; SCLK ; SCLK ; None ; None ; 6.435 ns ;
; N/A ; 140.10 MHz ( period = 7.138 ns ) ; i[2] ; S_PFr[17] ; SCLK ; SCLK ; None ; None ; 6.429 ns ;
; N/A ; 140.23 MHz ( period = 7.131 ns ) ; i[2] ; S_PFr[0] ; SCLK ; SCLK ; None ; None ; 6.422 ns ;
; N/A ; 141.88 MHz ( period = 7.048 ns ) ; i[5] ; S_PFr[44] ; SCLK ; SCLK ; None ; None ; 6.339 ns ;
; N/A ; 141.92 MHz ( period = 7.046 ns ) ; i[0] ; S_PFr[21] ; SCLK ; SCLK ; None ; None ; 6.337 ns ;
; N/A ; 141.92 MHz ( period = 7.046 ns ) ; i[0] ; S_PFr[25] ; SCLK ; SCLK ; None ; None ; 6.337 ns ;
; N/A ; 142.69 MHz ( period = 7.008 ns ) ; i[5] ; S_PFr[16] ; SCLK ; SCLK ; None ; None ; 6.299 ns ;
; N/A ; 143.86 MHz ( period = 6.951 ns ) ; i[3] ; S_PFr[5] ; SCLK ; SCLK ; None ; None ; 6.242 ns ;
; N/A ; 144.22 MHz ( period = 6.934 ns ) ; i[5] ; S_PFr[18] ; SCLK ; SCLK ; None ; None ; 6.225 ns ;
; N/A ; 144.89 MHz ( period = 6.902 ns ) ; i[3] ; S_PFr[44] ; SCLK ; SCLK ; None ; None ; 6.193 ns ;
; N/A ; 145.07 MHz ( period = 6.893 ns ) ; i[4] ; S_PFr[8] ; SCLK ; SCLK ; None ; None ; 6.184 ns ;
; N/A ; 145.12 MHz ( period = 6.891 ns ) ; i[4] ; S_PFr[2] ; SCLK ; SCLK ; None ; None ; 6.182 ns ;
; N/A ; 145.22 MHz ( period = 6.886 ns ) ; i[3] ; S_PFr[4] ; SCLK ; SCLK ; None ; None ; 6.177 ns ;
; N/A ; 145.29 MHz ( period = 6.883 ns ) ; i[3] ; S_PFr[20] ; SCLK ; SCLK ; None ; None ; 6.174 ns ;
; N/A ; 145.35 MHz ( period = 6.880 ns ) ; i[4] ; S_PFr[1] ; SCLK ; SCLK ; None ; None ; 6.171 ns ;
; N/A ; 145.35 MHz ( period = 6.880 ns ) ; i[4] ; S_PFr[3] ; SCLK ; SCLK ; None ; None ; 6.171 ns ;
; N/A ; 145.41 MHz ( period = 6.877 ns ) ; i[4] ; S_PFr[4] ; SCLK ; SCLK ; None ; None ; 6.168 ns ;
; N/A ; 145.52 MHz ( period = 6.872 ns ) ; i[3] ; S_PFr[8] ; SCLK ; SCLK ; None ; None ; 6.163 ns ;
; N/A ; 145.58 MHz ( period = 6.869 ns ) ; i[3] ; S_PFr[24] ; SCLK ; SCLK ; None ; None ; 6.160 ns ;
; N/A ; 145.62 MHz ( period = 6.867 ns ) ; i[1] ; S_PFr[16] ; SCLK ; SCLK ; None ; None ; 6.158 ns ;
; N/A ; 146.71 MHz ( period = 6.816 ns ) ; i[2] ; S_PFr[4] ; SCLK ; SCLK ; None ; None ; 6.107 ns ;
; N/A ; 146.78 MHz ( period = 6.813 ns ) ; i[2] ; S_PFr[20] ; SCLK ; SCLK ; None ; None ; 6.104 ns ;
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; N/A ; 147.04 MHz ( period = 6.801 ns ) ; i[2] ; S_PFr[24] ; SCLK ; SCLK ; None ; None ; 6.092 ns ;
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; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
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+------------------------------------------------------------------+
; tsu ;
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; Slack ; Required tsu ; Actual tsu ; From ; To ; To Clock ;
+-------+--------------+------------+-------+-----------+----------+
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; N/A ; None ; 0.482 ns ; SEN ; i[3] ; SCLK ;
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+-------+--------------+------------+-------+-----------+----------+
+------------------------------------------------------------------------+
; tco ;
+-------+--------------+------------+------------+----------+------------+
; Slack ; Required tco ; Actual tco ; From ; To ; From Clock ;
+-------+--------------+------------+------------+----------+------------+
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; N/A ; None ; 8.204 ns ; S_PFr2[1] ; S_PF[1] ; clk ;
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+-------+--------------+------------+------------+----------+------------+
+------------------------------------------------------------------------+
; th ;
+---------------+-------------+-----------+-------+-----------+----------+
; Minimum Slack ; Required th ; Actual th ; From ; To ; To Clock ;
+---------------+-------------+-----------+-------+-----------+----------+
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; N/A ; None ; -1.206 ns ; SEN ; S_PFr[9] ; SCLK ;
; N/A ; None ; -1.218 ns ; SEN ; S_PFr[11] ; SCLK ;
; N/A ; None ; -1.382 ns ; SEN ; S_PFr[20] ; SCLK ;
; N/A ; None ; -1.385 ns ; SEN ; S_PFr[24] ; SCLK ;
; N/A ; None ; -1.487 ns ; SEN ; S_PFr[10] ; SCLK ;
; N/A ; None ; -1.489 ns ; SEN ; S_PFr[12] ; SCLK ;
; N/A ; None ; -1.492 ns ; SEN ; S_PFr[45] ; SCLK ;
; N/A ; None ; -1.494 ns ; SEN ; S_PFr[14] ; SCLK ;
; N/A ; None ; -1.494 ns ; SEN ; S_PFr[41] ; SCLK ;
; N/A ; None ; -1.494 ns ; SEN ; S_PFr[42] ; SCLK ;
; N/A ; None ; -1.497 ns ; SEN ; S_PFr[6] ; SCLK ;
; N/A ; None ; -1.498 ns ; SEN ; S_PFr[7] ; SCLK ;
; N/A ; None ; -1.580 ns ; SEN ; S_PFr[17] ; SCLK ;
; N/A ; None ; -1.584 ns ; SEN ; S_PFr[16] ; SCLK ;
; N/A ; None ; -1.596 ns ; SEN ; S_PFr[37] ; SCLK ;
; N/A ; None ; -1.704 ns ; SEN ; S_PFr[35] ; SCLK ;
; N/A ; None ; -1.796 ns ; SEN ; S_PFr[21] ; SCLK ;
; N/A ; None ; -1.796 ns ; SEN ; S_PFr[25] ; SCLK ;
; N/A ; None ; -1.836 ns ; SEN ; S_PFr[18] ; SCLK ;
; N/A ; None ; -1.956 ns ; SEN ; S_PFr[33] ; SCLK ;
; N/A ; None ; -2.018 ns ; SEN ; S_PFr[15] ; SCLK ;
; N/A ; None ; -2.079 ns ; SEN ; S_PFr[38] ; SCLK ;
; N/A ; None ; -2.101 ns ; SEN ; S_PFr[19] ; SCLK ;
; N/A ; None ; -2.162 ns ; SEN ; S_PFr[13] ; SCLK ;
; N/A ; None ; -2.287 ns ; SEN ; S_PFr[1] ; SCLK ;
; N/A ; None ; -2.287 ns ; SEN ; S_PFr[3] ; SCLK ;
; N/A ; None ; -2.650 ns ; SEN ; S_PFr[39] ; SCLK ;
; N/A ; None ; -2.663 ns ; SEN ; S_PFr[46] ; SCLK ;
; N/A ; None ; -2.715 ns ; SEN ; S_PFr[5] ; SCLK ;
; N/A ; None ; -2.780 ns ; SEN ; S_PFr[43] ; SCLK ;
; N/A ; None ; -2.962 ns ; SEN ; S_PFr[32] ; SCLK ;
; N/A ; None ; -2.973 ns ; SEN ; S_PFr[34] ; SCLK ;
; N/A ; None ; -3.007 ns ; SEN ; S_PFr[36] ; SCLK ;
; N/A ; None ; -3.013 ns ; SEN ; S_PFr[47] ; SCLK ;
; N/A ; None ; -3.339 ns ; SEN ; S_PFr[44] ; SCLK ;
+---------------+-------------+-----------+-------+-----------+----------+
+--------------------------+
; Timing Analyzer Messages ;
+--------------------------+
Info: *******************************************************************
Info: Running Quartus II Classic Timing Analyzer
Info: Version 9.0 Build 132 02/25/2009 SJ Full Version
Info: Processing started: Tue Jan 03 15:28:01 2012
Info: Command: quartus_tan --read_settings_files=off --write_settings_files=off PF1 -c PF1
Info: Parallel compilation is enabled and will use 2 of the 2 processors detected
Info: Started post-fitting delay annotation
Info: Delay annotation completed successfully
Warning: Found pins functioning as undefined clocks and/or memory enables
Info: Assuming node "clk" is an undefined clock
Info: Assuming node "SCLK" is an undefined clock
Info: Clock "clk" has Internal fmax of 95.93 MHz between source register "cnt[17]" and destination register "S_PFr2[41]" (period= 10.424 ns)
Info: + Longest register to register delay is 9.715 ns
Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LC_X5_Y3_N9; Fanout = 5; REG Node = 'cnt[17]'
Info: 2: + IC(3.167 ns) + CELL(0.200 ns) = 3.367 ns; Loc. = LC_X5_Y4_N2; Fanout = 1; COMB Node = 'LessThan0~0'
Info: 3: + IC(0.741 ns) + CELL(0.740 ns) = 4.848 ns; Loc. = LC_X5_Y4_N6; Fanout = 1; COMB Node = 'LessThan0~4'
Info: 4: + IC(0.305 ns) + CELL(0.200 ns) = 5.353 ns; Loc. = LC_X5_Y4_N7; Fanout = 72; COMB Node = 'cnt[20]~44'
Info: 5: + IC(3.771 ns) + CELL(0.591 ns) = 9.715 ns; Loc. = LC_X3_Y1_N5; Fanout = 2; REG Node = 'S_PFr2[41]'
Info: Total cell delay = 1.731 ns ( 17.82 % )
Info: Total interconnect delay = 7.984 ns ( 82.18 % )
Info: - Smallest clock skew is 0.000 ns
Info: + Shortest clock path from clock "clk" to destination register is 3.348 ns
Info: 1: + IC(0.000 ns) + CELL(1.163 ns) = 1.163 ns; Loc. = PIN_12; Fanout = 76; CLK Node = 'clk'
Info: 2: + IC(1.267 ns) + CELL(0.918 ns) = 3.348 ns; Loc. = LC_X3_Y1_N5; Fanout = 2; REG Node = 'S_PFr2[41]'
Info: Total cell delay = 2.081 ns ( 62.16 % )
Info: Total interconnect delay = 1.267 ns ( 37.84 % )
Info: - Longest clock path from clock "clk" to source register is 3.348 ns
Info: 1: + IC(0.000 ns) + CELL(1.163 ns) = 1.163 ns; Loc. = PIN_12; Fanout = 76; CLK Node = 'clk'
Info: 2: + IC(1.267 ns) + CELL(0.918 ns) = 3.348 ns; Loc. = LC_X5_Y3_N9; Fanout = 5; REG Node = 'cnt[17]'
Info: Total cell delay = 2.081 ns ( 62.16 % )
Info: Total interconnect delay = 1.267 ns ( 37.84 % )
Info: + Micro clock to output delay of source is 0.376 ns
Info: + Micro setup delay of destination is 0.333 ns
Info: Clock "SCLK" has Internal fmax of 126.07 MHz between source register "i[4]" and destination register "S_PFr[44]" (period= 7.932 ns)
Info: + Longest register to register delay is 7.223 ns
Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LC_X3_Y2_N5; Fanout = 8; REG Node = 'i[4]'
Info: 2: + IC(1.018 ns) + CELL(0.511 ns) = 1.529 ns; Loc. = LC_X3_Y2_N9; Fanout = 7; COMB Node = 'Decoder0~1'
Info: 3: + IC(2.334 ns) + CELL(0.200 ns) = 4.063 ns; Loc. = LC_X6_Y1_N2; Fanout = 4; COMB Node = 'Decoder0~23'
Info: 4: + IC(2.569 ns) + CELL(0.591 ns) = 7.223 ns; Loc. = LC_X4_Y2_N7; Fanout = 2; REG Node = 'S_PFr[44]'
Info: Total cell delay = 1.302 ns ( 18.03 % )
Info: Total interconnect delay = 5.921 ns ( 81.97 % )
Info: - Smallest clock skew is 0.000 ns
Info: + Shortest clock path from clock "SCLK" to destination register is 6.206 ns
Info: 1: + IC(0.000 ns) + CELL(1.132 ns) = 1.132 ns; Loc. = PIN_41; Fanout = 54; CLK Node = 'SCLK'
Info: 2: + IC(4.156 ns) + CELL(0.918 ns) = 6.206 ns; Loc. = LC_X4_Y2_N7; Fanout = 2; REG Node = 'S_PFr[44]'
Info: Total cell delay = 2.050 ns ( 33.03 % )
Info: Total interconnect delay = 4.156 ns ( 66.97 % )
Info: - Longest clock path from clock "SCLK" to source register is 6.206 ns
Info: 1: + IC(0.000 ns) + CELL(1.132 ns) = 1.132 ns; Loc. = PIN_41; Fanout = 54; CLK Node = 'SCLK'
Info: 2: + IC(4.156 ns) + CELL(0.918 ns) = 6.206 ns; Loc. = LC_X3_Y2_N5; Fanout = 8; REG Node = 'i[4]'
Info: Total cell delay = 2.050 ns ( 33.03 % )
Info: Total interconnect delay = 4.156 ns ( 66.97 % )
Info: + Micro clock to output delay of source is 0.376 ns
Info: + Micro setup delay of destination is 0.333 ns
Info: tsu for register "S_PFr[44]" (data pin = "SEN", clock pin = "SCLK") is 3.893 ns
Info: + Longest pin to register delay is 9.766 ns
Info: 1: + IC(0.000 ns) + CELL(1.132 ns) = 1.132 ns; Loc. = PIN_40; Fanout = 8; PIN Node = 'SEN'
Info: 2: + IC(2.740 ns) + CELL(0.200 ns) = 4.072 ns; Loc. = LC_X3_Y2_N9; Fanout = 7; COMB Node = 'Decoder0~1'
Info: 3: + IC(2.334 ns) + CELL(0.200 ns) = 6.606 ns; Loc. = LC_X6_Y1_N2; Fanout = 4; COMB Node = 'Decoder0~23'
Info: 4: + IC(2.569 ns) + CELL(0.591 ns) = 9.766 ns; Loc. = LC_X4_Y2_N7; Fanout = 2; REG Node = 'S_PFr[44]'
Info: Total cell delay = 2.123 ns ( 21.74 % )
Info: Total interconnect delay = 7.643 ns ( 78.26 % )
Info: + Micro setup delay of destination is 0.333 ns
Info: - Shortest clock path from clock "SCLK" to destination register is 6.206 ns
Info: 1: + IC(0.000 ns) + CELL(1.132 ns) = 1.132 ns; Loc. = PIN_41; Fanout = 54; CLK Node = 'SCLK'
Info: 2: + IC(4.156 ns) + CELL(0.918 ns) = 6.206 ns; Loc. = LC_X4_Y2_N7; Fanout = 2; REG Node = 'S_PFr[44]'
Info: Total cell delay = 2.050 ns ( 33.03 % )
Info: Total interconnect delay = 4.156 ns ( 66.97 % )
Info: tco from clock "clk" to destination pin "S_PF[5]" through register "S_PFr2[5]" is 8.833 ns
Info: + Longest clock path from clock "clk" to source register is 3.348 ns
Info: 1: + IC(0.000 ns) + CELL(1.163 ns) = 1.163 ns; Loc. = PIN_12; Fanout = 76; CLK Node = 'clk'
Info: 2: + IC(1.267 ns) + CELL(0.918 ns) = 3.348 ns; Loc. = LC_X6_Y2_N1; Fanout = 2; REG Node = 'S_PFr2[5]'
Info: Total cell delay = 2.081 ns ( 62.16 % )
Info: Total interconnect delay = 1.267 ns ( 37.84 % )
Info: + Micro clock to output delay of source is 0.376 ns
Info: + Longest register to pin delay is 5.109 ns
Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LC_X6_Y2_N1; Fanout = 2; REG Node = 'S_PFr2[5]'
Info: 2: + IC(2.787 ns) + CELL(2.322 ns) = 5.109 ns; Loc. = PIN_5; Fanout = 0; PIN Node = 'S_PF[5]'
Info: Total cell delay = 2.322 ns ( 45.45 % )
Info: Total interconnect delay = 2.787 ns ( 54.55 % )
Info: th for register "i[2]" (data pin = "SEN", clock pin = "SCLK") is 0.072 ns
Info: + Longest clock path from clock "SCLK" to destination register is 6.206 ns
Info: 1: + IC(0.000 ns) + CELL(1.132 ns) = 1.132 ns; Loc. = PIN_41; Fanout = 54; CLK Node = 'SCLK'
Info: 2: + IC(4.156 ns) + CELL(0.918 ns) = 6.206 ns; Loc. = LC_X3_Y2_N3; Fanout = 13; REG Node = 'i[2]'
Info: Total cell delay = 2.050 ns ( 33.03 % )
Info: Total interconnect delay = 4.156 ns ( 66.97 % )
Info: + Micro hold delay of destination is 0.221 ns
Info: - Shortest pin to register delay is 6.355 ns
Info: 1: + IC(0.000 ns) + CELL(1.132 ns) = 1.132 ns; Loc. = PIN_40; Fanout = 8; PIN Node = 'SEN'
Info: 2: + IC(3.463 ns) + CELL(1.760 ns) = 6.355 ns; Loc. = LC_X3_Y2_N3; Fanout = 13; REG Node = 'i[2]'
Info: Total cell delay = 2.892 ns ( 45.51 % )
Info: Total interconnect delay = 3.463 ns ( 54.49 % )
Info: Quartus II Classic Timing Analyzer was successful. 0 errors, 1 warning
Info: Peak virtual memory: 130 megabytes
Info: Processing ended: Tue Jan 03 15:28:03 2012
Info: Elapsed time: 00:00:02
Info: Total CPU time (on all processors): 00:00:01
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